国家集成电路设计西安产业化基地
 
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全定制IC设计平台--Aether
 

 

•  工具介绍:
是一款功能强大、易学易用的混合信号IC设计平台,涵盖设计数据库管理(Design Manager)、原理图编辑器(Schematic Editor)和版图编辑器(Layout Editor)。原理图编辑器具有灵活的编辑功能和图形化的模拟平台,它支持业界标准数据格式及网表的导入导出;版图编辑器具有强大、完善的编辑功能,方便用户进行多层次、多单元的版图编辑,实现了最优的人机交互模型,加速产品上市时间。

•  Datasheet for Aether Download(请点击下载)
• 全定制IC设计平台--Aether 视频介绍


 

物理验证工具--Argus
 

 

•  工具介绍:
包括层次DRC(设计规则检查)和层次LVS(版图与原理图一致性比较)工具,用于帮助版图设计工程师快速定位版图设计错误,加速验证并缩短产品设计周期,是一个基于层次和并行算法的物理验证工具,能够满足深亚微米IC设计的验证需求。

•  Datasheet for Argus Download(请点击下载)
一致性检查工具Argus flashlvl 视频介绍

 

 

寄生参数提取工具--RCExplorer

 

•  工具介绍:
提供早期版本的寄生参数提取方案
内置布线引擎,支持未布线版图或者部分布线版图的全芯片寄生参数提取方案
提供第三方版图编辑工具的Plug-in
支持层次式提取方案
内置快速准确的三维场求解器

•  Datasheet for RCExplorer Download(请点击下载)

 

 

物理设计分析和优化平台--ICExplorer

 

•  工具介绍:
为深亚微米SoC设计提供全新的、更为高效的EDA解决方案
适用于物理设计,优化及验证
可解决复杂的时钟及时序问题
提供MCMM设计解决方案
替代传统物理实现工具完成耗时的、交互性强的繁杂调试工作,可实现综合/优化与调试流程并行操作

•  Datasheet for ICExplorer Download(请点击下载)

 

 

SoC时钟分析优化工具--ClockExplorer
 

•  工具介绍:
分析复杂SoC时钟结构和验证时钟相关的约束(SDC, CTS exceptions)
简化SoC时钟结构、优化时钟设计
低功耗MCMM时钟电路综合
目前最完善的解决SoC时钟问题的EDA工具

•  Datasheet for ClockExplorer Download(请点击下载)

 

 

时序优化工具--TimingExplorer
 

•  工具介绍:
提供MCMM (Multiple-Corner-Multiple-Mode) Timing Closure的解决方案
兼顾物理实现
准确、高校的优化策略,实现快速时序收敛
经过40nm设计验证

•  Datasheet for TimingExplorer Download(请点击下载)

 

 

高精度晶体管级电路仿真工具--Aeolus
 

•  工具介绍:
100% SPICE精度
显著的性能提升
单线程比传统SPICE工具有3-10倍的加速 在8核上并行仿真最高可提供额外的7倍加速 能够处理上千万元晶体管级规模的电路
能完美地集成到ZeniTM 平台

•  Datasheet for Aeolus Download(请点击下载)
• SPICE仿真工具--Aeolus 视频介绍

 

 

海量版图高效处理平台--Skipper
 

•  工具介绍:
Skipper是一个海量版图高效处理平台。它应用了优化的数据结构及内存管理方法,可以在相对较少的系统资源情况下,快速地完成百GB以上数据导入、管理、编辑和查找等功能,有效缩短投片改版时间。

•  Datasheet for SkipperDownload(请点击下载)
• Skipper工具进行IP merge操作 视频介绍
• 仿真波形查看软件I wave 视频介绍

 

 
 
 
 
   
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杭州:杭州国家集成电路设计产业化基地有限公司
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中科院EDA中心:中国科学院微电子研究所
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